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“隨著5G芯片越來越復雜，伴隨而來的是對工藝的要求也越來越高，驗證的復雜度越來越高，那么對于驗證的挑戰就會越來越大?！盋adence公司亞太區技術支持總監梁戈超說道。

8月22日，我愛方案網受邀參加2019中國（深圳）集成電路峰會。在本次峰會的分論壇之一——第十七屆中國通信集成電路技術應用研討會上，Cadence公司亞太區技術支持總監梁戈超針對5G芯片的驗證挑戰進行分析，并給出5G互聯網世界的驗證新策略。

梁戈超指出，5G有幾個跟前代的2G、3G、4G有以下幾大顯著的特點：

第一，高帶寬；
第二，低延時；
第三，網絡可靠性；
第四，應用場景非常非常廣。

從技術層面來講，5G跟前幾代通信協議相比，最大的兩個不同是毫米波的深度應用和OOT。

傳統的就是RRU天線與BBU放在一起，5G則引入了一個新概念：基站與RRU放在一起，BBU其實只用一種基帶池的方式來實現。這能帶來網絡覆蓋的廣泛特點，并且基站整體會比較小。

2019年的芯片與工藝的統計數據顯示，隨著芯片工藝規模越大，驗證的復雜度越來越高，那么對于驗證的挑戰就會越來越大。

從Cadence過往跟很多系統公司的合作經驗來看，在芯片驗證過程中，5納米、7納米、10納米工藝的芯片的軟件部分在系統的驗證中所占的比重越來越大，其次就是RTL硬件的驗證。基本上隨著芯片的規模越來越大，驗證所帶來的挑戰其實呈指數次方來增長的。

5G的很多通信芯片都是SoC芯片。那么，針對SoC 架構，如何來進行驗證呢？

Soc芯片有AP，AP與CP有高速的接口互聯，有DDR，可能會有HBM，可能還會有CCS這樣的高速接口。VPU有很多種實現方式：有的用DPU來實現，有的用LOgc來實現。

Soc芯片如果要搭建一個驗證和測試的環境，相關的接口比如射頻部分可以連接在5G的測試儀。目前市面上可供選擇的5G測試儀只有三家：Keysight、羅德、安利。然后對5G的SoC芯片做驗證。

對于仿真而言最重要是仿真速度，往上走就是不同級別的抽象。從芯片定義到最終端，其實對于階段來講會有不同的表現形式。

最開始要做系統架構的建模，在整個驗證過程中，要考慮如何衡量驗證階段的收斂程度。其次要考慮軟件跑起來后如何進行Debug，如何提高DeBug的效率等問題。

Cadence提供三個不同的仿真平臺，針對不同的級別在不同的平臺上做方案。

這三個仿真平臺分別是：Xcelium  Simulation、Palladium、Protium  Prototyping。

對于Xcelium Simulation和Palladium之間的區別，梁戈超解釋說：“我的設計信號能夠看，對于我來說要有一些很充分的Debug能力，整個時間就是出版本的時間，那這個時間一定要短。當然還有一點，Peformance一定要比Palladium要快。第二點，邊緣時間。如果大家用過APA大家很清楚，中間很有Menue的Worke，但是用Protium  S1，基本上出版本的時候是完全自動化的?；旧蟈1能給你提供一個完整的解決方案，Palladium  Z1到Protium是非常完整的切換?！?/p>

梁戈超表示，5G的SoC越來越復雜，尤其上到7納米、5納米，基本上規模就是上10億、20億、30億的規模，對于這樣規模來講，放在平臺基本上不可能的，大部分需要拆成不同模塊進行運行。但這樣會出現一個問題，在平臺上驗證的結果與真正的結果其實是不一樣的。

Protium  X1解決的問題是在全芯片基本上不用改的情況下，在平臺上就能完全自動化跑完。也就是說，在軟件驗證的過程中，其實在OS階段會有一個VSP的平臺，能夠給你在整個C  Model平臺上去跑仿真，這個階段會初期來驗證軟件。隨著RTL慢慢成熟了，可以考慮用IP  Hybrid，通過這種方式來加速OS過程。

總的來說，5G芯片越來越復雜，按照傳統的做法，不管是軟件或者硬件都需要靠開發人員、測試人員自己手動操作，很費事，需要依靠工具來提高開發測試的生產效率。Cadence提供四個Verification。例如，JCadence  Verification  Suite。在芯片期可以采用，不需要去開發激勵，僅僅是根據你設計的一些時間和狀態機的跳轉設減，通過設減的方式；像VIP，Vmanager，Indago  Perspec，Cadence也能夠提供一套工具鏈，進行5G的驗證。